| 階段 |
培訓(xùn)內(nèi)容 |
| 第一階段 |
- 1, Cadence Virtuoso EDA tool使用流程
- 2, 虛擬機(jī)的設(shè)置技巧
- 4, Linux和 Windows間數(shù)據(jù)自由共享的方法
- 5, 仿真SPICE庫介紹，.scs庫的關(guān)鍵代碼解析
- 6, 仿真模型分析
- 7, 原理圖設(shè)計(jì)流程和技巧
- 8, 庫,CELL，instance，pin,power,NMOS,PMOS的使用，與SPICE模型的結(jié)合和創(chuàng)建技巧
- 9, Cadence Virtuoso Spectre Spice仿真環(huán)境設(shè)置
- 10, CDS工作區(qū)環(huán)境設(shè)置技巧
- 11,電路靜態(tài)工作點(diǎn)仿真和設(shè)置
- 12,Cadence Virtuoso Spectre Spice Result Browser的使用
- 13,CMOS模擬電路設(shè)計(jì)和工廠工藝的結(jié)合
- 14,CMOS模擬電路設(shè)計(jì)參數(shù)公式計(jì)算并DC仿真案例
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實(shí)驗(yàn)：
- 虛擬機(jī)下的LINUX和Windows數(shù)據(jù)自由共享的設(shè)置實(shí)驗(yàn)
- CDS工作環(huán)境快速設(shè)置實(shí)驗(yàn)
- CMOS反相器設(shè)計(jì)公式計(jì)算實(shí)驗(yàn)
- CMOS反相器設(shè)計(jì)原理圖設(shè)計(jì)整理流程和技巧使用實(shí)驗(yàn)
- CMOS反相器設(shè)計(jì)DC仿真實(shí)驗(yàn)
- 實(shí)驗(yàn)結(jié)果Vth,Vgs,Vds等的獲取。
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| 第二階段 |
- CMOS電流鏡，電流源，電壓源設(shè)計(jì)詳解和設(shè)計(jì)技巧
- CMOS比較器設(shè)計(jì)詳解、設(shè)計(jì)技巧和仿真
- CMOS模數(shù)的CELL創(chuàng)建方法、編輯技巧和使用
- CMOS模數(shù)的設(shè)計(jì)、開發(fā)規(guī)范
- CMOS模數(shù)混合仿真的流程和技巧
- CMOS更復(fù)雜實(shí)際設(shè)計(jì)電路設(shè)計(jì)流程（結(jié)合工廠工藝進(jìn)行公式計(jì)算和仿真）
- 根據(jù)給定的電流，輸出電壓等條件結(jié)合工廠工藝進(jìn)行設(shè)計(jì)的技巧。
- DC掃描參數(shù)設(shè)定
- CMOS集成電流交流小信號增益設(shè)計(jì)仿真流程和技巧
- CMOS集成電路設(shè)計(jì)與瞬態(tài)仿真分析
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實(shí)驗(yàn)：
- CMOS高效電阻負(fù)載的共源放大器設(shè)計(jì)實(shí)驗(yàn)
- CMOS高效電阻負(fù)載的共源放大器結(jié)合工廠工藝和公式進(jìn)行參數(shù)，DC仿真，交流小信號增益仿真
- 交流小信號增益仿真
- AC仿真實(shí)驗(yàn)
- 瞬態(tài)仿真分析實(shí)驗(yàn)
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| 第三階段 |
- Circuit Optimizer使用技巧
- 電路設(shè)計(jì)優(yōu)化器使用流程
- 怎樣用自動化的方法，把NMOS/PMOS寬、長,電阻，電容，電壓值等CMOS集成電路中出現(xiàn)的所有參數(shù)都考慮進(jìn)去，并且給定多個(gè)控制目標(biāo)的情況下快速把電路調(diào)到佳狀態(tài)。
- CMOS實(shí)際電路實(shí)際演示怎樣考慮電路中的所有參數(shù)并指定多個(gè)控制目標(biāo)的情況下，快速優(yōu)化CMOS集成電路到佳狀態(tài)，并求出NMOS/PMOS寬、長,電阻，電容等等元件的佳值。
- CMOS電路設(shè)計(jì)結(jié)合制造工藝各種極端情況的考慮。
- 多工藝角仿真流程，工多組藝角設(shè)置及技巧。
- 優(yōu)化器仿真流程，變量設(shè)置，目標(biāo)設(shè)置及設(shè)計(jì)技巧。
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實(shí)驗(yàn)：
- CMOS電路設(shè)計(jì)實(shí)驗(yàn)
- CMOS實(shí)際電路多參數(shù)多控制目標(biāo)電路優(yōu)化及元件參數(shù)計(jì)算實(shí)驗(yàn)
- 多工藝角仿真實(shí)驗(yàn)
- Circuit Optimizer設(shè)計(jì)仿真實(shí)驗(yàn)
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| 第四階段 |
- 根據(jù)設(shè)計(jì)要求的增益和擺幅，電壓，電流等要求，完整設(shè)計(jì)一個(gè)CMOS集成電路，案例
1）高效共源放大器增益和擺幅，電壓，電流等設(shè)計(jì)要求分析
2）結(jié)合工藝進(jìn)行參數(shù)公式計(jì)算
3）增益和相位裕度SPICE仿真流程和技巧
4）溫度SPICE仿真
5）輸出電壓擺幅仿真
6）AC仿真
7）噪聲仿真
6）AC仿真
7）Cadence Virtuoso Spectre Spice 噪聲仿真
2，噪聲仿真流程和技巧
1）輸入噪聲和輸出噪聲的設(shè)置
2）仿真參數(shù)的選擇
3) 注意事項(xiàng)
3, Parametric Analysis仿真
1) 多變量同時(shí)掃描
2) 多參數(shù)選擇
3) Cadence Virtuoso Spectre Spice Temp
4, 溫度仿真流程和技巧
1) 溫度范圍的設(shè)置
2) 注意事項(xiàng)
5, 復(fù)雜放大器設(shè)計(jì)詳解和設(shè)計(jì)技巧 |
實(shí)驗(yàn)：
- 根據(jù)設(shè)計(jì)要求的增益和擺幅，電壓，電流等要求，完整設(shè)計(jì)一個(gè)CMOS集成電路實(shí)驗(yàn)
- Cadence Virtuoso Spectre Spice增益和相位裕度仿真實(shí)驗(yàn)
- Cadence Virtuoso Spectre Spice溫度仿真實(shí)驗(yàn)
- Parametric Analysis仿真實(shí)驗(yàn)
- Cadence Virtuoso Spectre Spice噪聲仿真實(shí)驗(yàn)
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| 第五階段 |
1，根據(jù)設(shè)計(jì)要求的增益和擺幅，電壓，電流等要求，完整設(shè)計(jì)一個(gè)CMOS集成電路，案例
1）高效差分器增益和擺幅，電壓，電流等設(shè)計(jì)要求分析
2）結(jié)合工藝進(jìn)行參數(shù)公式計(jì)算
3）增益和相位裕度仿真流程和技巧
4）溫度仿真
5）輸出電壓擺幅仿真
6）AC仿真
7）噪聲仿真
2，數(shù)模混合設(shè)計(jì)深入講解
3，數(shù)模混合設(shè)計(jì)的注意技巧
4,CMOS放大器設(shè)計(jì)詳解和設(shè)計(jì)技巧
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實(shí)驗(yàn)：
- 根據(jù)設(shè)計(jì)要求的增益和擺幅，電壓，電流等要求，完整設(shè)計(jì)一個(gè)CMOS集成電路強(qiáng)化實(shí)驗(yàn)
- 增益和相位裕度仿真實(shí)驗(yàn)
- 數(shù)模混合設(shè)計(jì)實(shí)驗(yàn)
- 數(shù)模混合仿真實(shí)驗(yàn)
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| 第六階段 |
- CMOS運(yùn)放反饋設(shè)計(jì)詳解和設(shè)計(jì)技巧
- 運(yùn)放穩(wěn)定性與頻率補(bǔ)償
- CMOS比較器設(shè)計(jì)詳解、設(shè)計(jì)技巧和仿真
- CMOS電流鏡電路分析與設(shè)計(jì)詳解、設(shè)計(jì)技巧
- 噪聲模型與分析詳解、設(shè)計(jì)技巧
- 總結(jié)
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實(shí)驗(yàn)：
- CMOS比較器設(shè)計(jì)和仿真實(shí)驗(yàn)
- 回顧
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